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伝搬遅延とは、信号が目的地に到達するまでの時間のことで、例えば電磁場、電線、気体、流体、固体などの中における伝搬遅延のことです。
論理ゲートのゲート遅延は、使用する技術によってピコ秒から10 ナノ秒以上に及ぶことがあります。 [ 1 ]これは、ゲート入力が安定してからゲート出力が安定するまでの時間です。メーカーは、入力が最終入力レベルの 50% に変化してから出力が最終出力レベルの 50% に達するまでの時間を指すことがよくあります。これはレベル変化の方向によって異なる場合があり、その場合は個別の立ち下がり遅延 t PHLと t PLH、または t fと t rが与えられます。
ゲート遅延を低減することで、デジタル回路はより高速にデータを処理できるようになり、全体的なパフォーマンスが向上します。複合回路の伝搬遅延を求めるには、入力から出力までの最長の伝搬遅延経路を特定し、その経路上の各伝搬遅延を合計する必要があります。
論理努力の原理は、伝搬遅延を利用して、同じ論理式を実装した設計を比較します。論理素子の伝搬遅延の差は、競合状態によって非同期回路にグリッチが発生する主な原因となります。
これらの要因はすべてRC時定数を介して互いに影響し合います。負荷容量が増加するとCが増加し、熱による抵抗がR係数に変化し、電源しきい値電圧が上昇すると、しきい値に達するまでに複数の時定数が必要になるかどうかに影響します。論理ゲートの出力が長い配線に接続されている場合、または他の多くのゲートを駆動するために使用される場合（高ファンアウト）、伝搬遅延は大幅に増加します。
コンピュータネットワークにおいて、伝搬遅延とは、信号の先頭が送信元から受信元に到達するまでにかかる時間のことです。これは、リンク長と特定の媒体における伝搬速度の比として計算できます。
伝搬遅延はd / sに等しく、dは距離、sは波の伝搬速度です。無線通信では、s = c、つまり光速です。銅線では、速度s は一般的に 0.59c から 0.77c の範囲です。[ 3 ] [ 4 ]この遅延は高速コンピュータの開発における主要な障害であり、 IC システムにおける相互接続のボトルネックと呼ばれています。